Betrachten Sie einen neuen MIPS-Prozessor mit einem 4-fach satz-assoziativen Da...
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Betrachten Sie einen neuen MIPS-Prozessor mit einem 4-fach satz-assoziativen Datencache, der 512 KByte Kapazität und 128 Byte Blockgröße aufweist. Adressen sind wie beim bekannten MIPS-Prozessor 32 Bit breit.
Wie viele Bits der Adresse werden für den Block-Offset verwendet?
Wie viele Bits der Adresse werden für den Index verwendet?
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